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了法寺ツール 2.20 として公開するものをコミットした。

おんぶおばけ2の情報だけ更新。

了法寺ツール 2.10 として公開するものをコミットした。

了法寺ツール 2.01 として公開するものをコミットした。

信仰によってセルの背景色が変わるようにした。

了法寺ツール 2.00 として公開するものをコミットした。

了法寺ツール 1.30 として公開するものをコミットした。

信仰を書き込む列を追加した。

了法寺ツール 1.20 として公開するものをコミットした。

四神デッキを追加した。

了法寺ツール 1.10 として公開するものをコミットした。

ゲーム「ようこそ了法寺へ」のデッキ構築を支援するシートを作成した。これをVer1.0とする。

ChipScopeでBSCANを観測した結果を、Tcvの文法で表現してみた。

VHDLで書かれたRESETSYNCを、Verilog HDLに移植した。

JTAGを経路として、FPGA-PC間の双方向通信を行えるようにした。

バグ修正:タスクの引数の名前を間違えると、v05to01.tclが無限ループに陥る というバグを対策した。

バグ修正：シミュレータ上で、JT_SELが1になってすぐDRCK_RISEが1になっていたので、それを対策した。

JTAG通信のシミュレーションを行えるようにした(ただしまだPC→FPGAの一方通行)

モジュールのポート部分の記述にあわせて、functionのスタイルをANSI-Cに直した。

Avnet LX9 MicroBoardで、JTAG通信を行えるようにした(ただしまだPC→FPGAの一方通行)

ファイルのクローズを忘れるバグを対策した。

compo.tclの可読性を上げた。

重複するソースファイルをtrunk直下のrtlディレクトリに移動した。

Linux上でも動作するように、svn:executableプロパティをスクリプト群に与えた。

Verilogソースからブラックボックスを作るスクリプトを追加した。

nbox_util.tclの配布物を作れるように、toolexport.rbを変更した。

打鍵数が多くて面倒なので名前を短くした。

ModelSimとActive-HDLに、gather_waveを移植した。

ウィンドウがフォアグラウンドになると自動でリロードされるようにした。

parser_debug.txtも配布物に含めるようにした。